MAJOR=7
MINOR=6
DEVNAME=vcs6
      ˆ729_•I|¥‰ÓMdœv ©ƒ&íK<óo¬À¿ Ù    <!DOCTYPE HTML PUBLIC "-//W3C//DTD HTML 4.01//EN" "http://www.w3.org/TR/html4/strict.dtd">
<html>
 <head>
  <title>Index of /FSS-OZR/root/sys/bus/mdio_bus/devices</title>
 </head>
 <body>
<h1>Index of /FSS-OZR/root/sys/bus/mdio_bus/devices</h1>
  <table>
   <tr><th valign="top">&nbsp;</th><th><a href="?C=N;O=A">Name</a></th><th><a href="?C=M;O=A">Last modified</a></th><th><a href="?C=S;O=A">Size</a></th><th><a href="?C=D;O=D">Description</a></th></tr>
   <tr><th colspan="5"><hr></th></tr>
<tr><td valign="top">&nbsp;</td><td><a href="/FSS-OZR/root/sys/bus/mdio_bus/">Parent Directory</a>       </td><td>&nbsp;</td><td align="right">  - </td><td>&nbsp;</td></tr>
   <tr><th colspan="5"><hr></th></tr>
</table>
</body></html>
  +   ˆl–Ü4ý( ©³( 	Å€fàB¦-ÿÂ„q÷ÄÏ_†I|¥�+ÂÁ ?÷     /* SPDX-License-Identifier: GPL-2.0+ */
/*
 * Copyright (C) 2016 Freescale Semiconductor, Inc.
 * Copyright 2017~2018 NXP
 */

#ifndef _IMX8QXP_PADS_H
#define _IMX8QXP_PADS_H

/* pin id */
#define IMX8QXP_PCIE_CTRL0_PERST_B                  0
#define IMX8QXP_PCIE_CTRL0_CLKREQ_B                 1
#define IMX8QXP_PCIE_CTRL0_WAKE_B                   2
#define IMX8QXP_COMP_CTL_GPIO_1V8_3V3_PCIESEP       3
#define IMX8QXP_USB_SS3_TC0                         4
#define IMX8QXP_USB_SS3_TC1                         5
#define IMX8QXP_USB_SS3_TC2                         6
#define IMX8QXP_USB_SS3_TC3                         7
#define IMX8QXP_COMP_CTL_GPIO_3V3_USB3IO            8
#define IMX8QXP_EMMC0_CLK                           9
#define IMX8QXP_EMMC0_CMD                           10
#define IMX8QXP_EMMC0_DATA0                         11
#define IMX8QXP_EMMC0_DATA1                         12
#define IMX8QXP_EMMC0_DATA2                         13
#define IMX8QXP_EMMC0_DATA3                         14
#define IMX8QXP_COMP_CTL_GPIO_1V8_3V3_SD1FIX0       15
#define IMX8QXP_EMMC0_DATA4                         16
#define IMX8QXP_EMMC0_DATA5                         17
#define IMX8QXP_EMMC0_DATA6                         18
#define IMX8QXP_EMMC0_DATA7                         19
#define IMX8QXP_EMMC0_STROBE                        20
#define IMX8QXP_EMMC0_RESET_B                       21
#define IMX8QXP_COMP_CTL_GPIO_1V8_3V3_SD1FIX1       22
#define IMX8QXP_USDHC1_RESET_B                      23
#define IMX8QXP_USDHC1_VSELECT                      24
#define IMX8QXP_CTL_NAND_RE_P_N                     25
#define IMX8QXP_USDHC1_WP                           26
#define IMX8QXP_USDHC1_CD_B                         27
#define IMX8QXP_CTL_NAND_DQS_P_N                    28
#define IMX8QXP_COMP_CTL_GPIO_1V8_3V3_VSELSEP       29
#define IMX8QXP_USDHC1_CLK                          30
#define IMX8QXP_USDHC1_CMD                          31
#define IMX8QXP_USDHC1_DATA0                        32
#define IMX8QXP_USDHC1_DATA1                        33
#define IMX8QXP_USDHC1_DATA2                        34
#define IMX8QXP_USDHC1_DATA3                        35
#define IMX8QXP_COMP_CTL_GPIO_1V8_3V3_VSEL3         36
#define IMX8QXP_ENET0_RGMII_TXC                     37
#define IMX8QXP_ENET0_RGMII_TX_CTL                  38
#define IMX8QXP_ENET0_RGMII_TXD0                    39
#define IMX8QXP_ENET0_RGMII_TXD1                    40
#define IMX8QXP_ENET0_RGMII_TXD2                    41
#define IMX8QXP_ENET0_RGMII_TXD3                    42
#define IMX8QXP_COMP_CTL_GPIO_1V8_3V3_ENET_ENETB0   43
#define IMX8QXP_ENET0_RGMII_RXC                     44
#define IMX8QXP_ENET0_RGMII_RX_CTL                  45
#define IMX8QXP_ENET0_RGMII_RXD0                    46
#define IMX8QXP_ENET0_RGMII_RXD1                    47
#define IMX8QXP_ENET0_RGMII_RXD2                    48
#define IMX8QXP_ENET0_RGMII_RXD3                    49
#define IMX8QXP_COMP_CTL_GPIO_1V8_3V3_ENET_ENETB1   50
#define IMX8QXP_ENET0_REFCLK_125M_25M               51
#define IMX8QXP_ENET0_MDIO                          52
#define IMX8QXP_ENET0_MDC                           53
#define IMX8QXP_COMP_CTL_GPIO_1V8_3V3_GPIOCT        54
#define IMX8QXP_ESAI0_F